单项选择题
Adder_dataflow U0_FA（S[0]，C0，A[0]，B[0]，C_1）；
对这句话理解正确的是（）。
A.这是一个模块实例引用语句
B.被引用的子模块名为U0_FA
C.子模块在父模块中的引用名为Adder_dataflow
D.子模块和父模块之间的端口信号的关联方式是位置关联
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单项选择题
定义一个4位的输出端口sum，以下（）表述是正确的。
A.output [3：0]sum；
B.output [4：0]sum；
C.output sum[3：0]；
D.output sum[4：0]； -
多项选择题
下面（）文件不是应用Quartus II自带仿真工具进行仿真需要创建的仿真激励文件。
A.Block diagram /Schematic File
B.University Program VWF
C.Verilog HDL File
D.VHDL File -
单项选择题
当程序调试完成后，选择（）下载方式将程序配置到FPGA芯片中。
A.AS
B.PS
C.JTAG
D.AS 或JTAG
